RF设计过程中降低信号耦合的PCB布线技巧
2012-06-02 8
新一轮蓝牙设备、无绳电话和蜂窝电话需求高潮正促使中国电子工程师越来越关注RF电路设计技巧。RF电路板的设计是最令设计工程师感到头疼的部分,如想一次获得成功,仔细规划和注重细节是必须加以高度重视的两大关键设计规则。 射频(RF)电路板设计由于在理论上还有很多不确定性,因此常被形容为一种“黑色艺术”, .. [查看全文]
用Protel99SE实现脉冲电路的仿真
2012-06-02 赵柏树 9
Protel设计系统作为电子设计自动化(EDA)软件中的佼佼者,一直受到广泛的欢迎。Protel99SE是Protel公司2000年推出的最新版本,内部集成了功能强大的模数混合仿真器,采用Spice仿真内核,含有丰富的器件模型库,能快速简便地实现大部分模块电路和数字电路的仿真[1~2]。且仿真结构十分精确,提高了电路设计的效率和效益。 .. [查看全文]
SPS PCB Layout细则
2012-06-02 11
1.線路圖繪制 : a. 調出相應元件符號,連接繪制;并給其賦与相應之PCB Decal; b. 檢查网絡是否有錯;零件編號是否有重覆、遣漏;(存盤) c. 檢查無誤﹐轉net list to PCB;應無錯誤報告. 2.PCB圖繪制 : a. 檢查其封裝及帶极性元件的网絡是否正确; b. 1、用AUTO-CAD繪制PCB外框,轉成*.dxf文件到POWER PCB里去; § 注意:轉到POW .. [查看全文]
Cadence的 EDA验证工具在 SOC设计中的应用
2012-06-02 叶 辉 5
摘要: 本文介绍了Cadence公司的NC-Verilog/Verilog-XL Simulator以及Signalscan在SOC设计中的应用。 关键词: SOC,协同验证(co-verification) 在ASIC 和 SOC 设计中,验证是极为重要的一环,Cadence公司的NC-Verilog仿真器(以及较早产品 Verilog-XL)是用来仿真用 Verilog 语言写的数字逻辑电路。该仿真器在 ASIC和SO .. [查看全文]
电容在高速PCB设计中的应用
2012-06-02 10
探讨高速PCB设计电容的应用。电容是电路板上不可缺少的一个部分,并且起到了至关重要的作用,探讨它具备至关重要的价值。您在设计中是否有这样困惑:我要用什么样的电容?需要多少这样电容?要如何放置这样的电容?带着这些疑问我们走入我们的正题笫—部分、电容的分类电容在电路的设计中从应用上进行分类,可以将电容分为四类 .. [查看全文]
PCB Layout 中的直角走线、差分走线和蛇形线
2012-06-02 月光王子 10
布线(Layout)是PCB设计工程师最基本的工作技能之一。走线的好坏将直接影响到整个系统的性能,大多数高速的设计理论也要最终经过 Layout 得以实现并验证,由此可见,布线在高速 PCB 设计中是至关重要的。下面将针对实际布线中可能遇到的一些情况,分析其合理性,并给出一些比较优化的走线策略。主要从直角走线,差分走线, .. [查看全文]
差分阻抗-什么是差分?
2012-06-02 Douglas Brooks 21
翻译:Michael Qiao 当你认为你已经掌握了PCB 走线的特征阻抗Z0,紧接着一份数据手册告诉你去设计一个特定的差分阻抗。令事情变得更困难的是,它说:“……因为两根走线之间的耦合可以降低有效阻抗,使用50Ω的设计规则来得到一个大约80Ω的差分阻抗!”这的确让人感到困惑! 这篇文章向你展示什么是差 .. [查看全文]
Protel中加宽电源/接地线的方法
2012-06-02 17
为了提高电路的抗干扰能力,增强系统的可靠性,往往需要将印刷电路板上的电源/接地线加宽,这一点在模拟电路或数字/模拟混合电路中尤为重要。一般至少要将电源/接地线宽度增加到普通信号线宽度的三倍以上,对于一些电流较大的线路,为了减少导线电阻往往也需要进行加宽。加宽电源/接地线的具体办法如下: 1、在布线前制定 .. [查看全文]
如何在Altium Designer中导入Allegro的brd文件
2012-06-02 59
课题组其他人都用Allegro,我一个人死撑着用AD。共享设计时原理图还方便导入,PCB文件麻烦了,于是一直在找如何从AD中导入Allegro的brd文件的方法,一直未果(曾经找了个CAMCAD Pro,号称可以,但不会用--呵呵,也可能是不可以)。 AD 不支持导入allegro的brd文件,orcad的layout的max文件倒是支持,可是同为cadence的 .. [查看全文]

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